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LB

RISC-V LB 指令详解

指令手册I-type

从内存加载8位字节,符号扩展至 XLEN 后写入 rd

指令语法

lb rd, offset(rs1)
操作数说明
目标寄存器 rd:存放运算结果的通用寄存器。
源寄存器 rs1:第一个操作数所在的寄存器。
立即数 imm:12 位有符号立即数,符号扩展后与 rs1 进行运算。
RV32IRV64I内存加载

指令行为说明

LB 是 RV32I/RV64I 的 I 型加载指令(opcode=0000011, funct3=000)。有效地址由 rs1 与符号扩展的 12 位偏移相加得到;它从该地址读取 8 位字节,符号扩展至 XLEN 后写入 rd。字节访问在任何字节地址上都自然对齐;地址是否合法及其他访问限制由执行环境接口(EEI)定义。

LB 指令解析与执行动画

从机器码字段解析开始,依次展示操作数读取、该指令专属语义计算和 ISA 可见状态更新。

rd
imm
rs1
lb
,
(
)
执行环境

本例使用固定寄存器初值和初始 PC=0x2000;取指成功,没有异步中断或额外扩展检查。异常分支只显示普通提交停止,陷入后的 PC 和处理程序状态由 EEI 决定。

假定普通内存可读;每个所选有效地址处使用上方固定的内存示例值。只建模非对齐 EEI 分支,不建模地址权限或设备副作用。字节访问始终自然对齐;成功加载后 PC+4,异常时不作普通写回。

a0(x10)
0x00001000
mem[0x00001000]
0x000000F2
31..20
19..15
14..12
11..7
6..0
000000000000
imm[11:0]
01010
rs1
000
funct3
00101
rd
0000011
opcode
执行数据路径
instruction
0x00050283
opcode
0000011 -> LOAD
funct3
000 -> LB
rd / base
t0(x5) / a0(x10)=0x00001000
offset
000000000000 -> 0; ea=0x00001000 (naturally aligned (1-byte))
load
尚未计算
x5
t0(x5) = 0x00003001; pc = 0x00002000
当前步骤

概念步骤:拿到 32-bit 指令编码

机器码按当前指令格式切成字段,动画从 encoding/decode 开始。

encoding: 0x00050283
syntax : lb x5, 0(x10)
待提交结果: 尚未计算
当前架构状态
t0(x5) = 0x00003001; pc = 0x00002000

该动画展示 ISA 可见的解码和状态变化,不表示任何特定 CPU 的流水线、缓存、预测或时序实现。

快速理解与检索要点

LB 从 rs1 加 12 位有符号偏移形成的有效地址读取8 位字节,然后符号扩展写入 rd。

所有基础 load 都使用 rs1 + 符号扩展 12 位偏移形成有效字节地址。
字节访问在任何字节地址上都自然对齐;这不保证地址合法,也不免除其他访问异常。
rd=x0 时加载值被丢弃,但访问异常和其他副作用仍须发生。

常见使用场景

字节数据加载

结合 «lb x5, 0(x10) # x5 = sign_ext(mem[x10+0][7:0])» 等实际代码理解该场景。

符号扩展

结合 «lb x5, 0(x10) # x5 = sign_ext(mem[x10+0][7:0])» 等实际代码理解该场景。

使用前检查清单

语法检查
  • 使用 rd, offset(rs1);offset 是 -2048 到 2047 的有符号字节偏移。
  • rd 与 rs1 选择整数寄存器 x0 到 x31,或其 ABI 名称。
语义检查
  • LB/LH 分别把 8/16 位加载值符号扩展到 XLEN。
  • 字节访问始终自然对齐,但仍需满足 EEI 的合法地址及访问限制;rd=x0 也不免除异常和其他副作用。

容易混淆 / 常见误区

有符号扩展:若字节最高位为1,高位全填1
字节访问天然对齐,但 rd=x0 也不能免除访问异常或其他副作用。

常见问题

LB 的地址偏移范围是多少?

偏移量是符号扩展的 12 位字节偏移,范围为 -2048 到 2047。

有符号加载和无符号加载有什么区别?

LB/LH/LW 会把加载值符号扩展到 XLEN;LBU/LHU 会零扩展。RV64 中需要零扩展 32 位字时使用 LWU。